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龍圖騰網獲悉安徽大學申請的專利多比特運算模塊以及使用了該模塊的存內計算電路結構獲國家發明授權專利權，本發明授權專利權由國家知識產權局授予，授權公告號為：CN115954029B 。

龍圖騰網通過國家知識產權局官網在2025-08-29發布的發明授權授權公告中獲悉：該發明授權的專利申請號/專利號為：202310026356.1，技術領域涉及：G11C11/419；該發明授權多比特運算模塊以及使用了該模塊的存內計算電路結構是由周永亮;周子璇;施琦;楊震;韋一鳴;彭春雨;吳秀龍設計研發完成，并于2023-01-09向國家知識產權局提交的專利申請。

本多比特運算模塊以及使用了該模塊的存內計算電路結構在說明書摘要公布了：本發明涉及靜態隨機存儲器技術領域，更具體的，涉及多比特運算模塊，以及使用了該模塊的存內計算電路結構。本發明的多比特運算模塊通過計算位線負載電容的放電累加完成了多比特乘累加運算，分比特權重和分離全局位線的設計具有良好的計算并行度和穩定性，具有較高的推理精度，且與后續的量化單元模塊配合獲得量化輸出，可支持深度神經網絡中多比特MAC運算。

本發明授權多比特運算模塊以及使用了該模塊的存內計算電路結構在權利要求書中公布了：1.多比特運算模塊，其用于實現多比特乘累加計算，其特征在于，所述多比特運算模塊包括： 分比特計算模塊一，其包括n個級聯計算單元一、n條權重位線一LW[1]～LW[n]； 其中，第k個級聯計算單元一包括： NMOS管N1[k]，其柵極連接權重位線一LW[k]，漏極連接計算位線CBL，源極連接節點一X1[k]； NMOS管N2[k]，其柵極連接權重位線一LW[k]，漏極連接計算位線CBLB，源極連接節點二X2[k]；N1[k]、N2[k]的規格相同； NMOS管N3[k]，其柵極連接全局位線GBL，漏極連接節點一X1[k]，源極連接地GND；以及 NMOS管N4[k]，其柵極連接全局位線GBLB，漏極連接節點二X2[k]，源極連接地GND；1≤k≤n； 分比特計算模塊二，其包括n個級聯計算單元二、n條偶數權重位線二RW[1]～RW[n]； 其中，第k個級聯計算單元二包括： NMOS管N5[k]，其柵極連接權重位線二RW[k]，漏極連接計算位線CBL，源極連接節點三X3[k]； NMOS管N6[k]，其柵極連接權重位線二RW[k]，漏極連接計算位線CBLB，源極連接節點四X4[k]；N5[k]、N6[k]的規格相同； NMOS管N7[k]，其柵極連接全局位線GBL，漏極連接節點三X3[k]，源極連接地GND；以及 NMOS管N8[k]，其柵極連接全局位線GBLB，漏極連接節點四X4[k]，源極連接地GND；N7[k]、N8[k]、N3[k]、N4[k]的規格相同，N5[k]寬長比是N1[k]寬長比的h倍； 權重位線二RW[k]、權重位線一LW[k]用于提供權重值；全局位線GBL、GBLB用于提供多比特輸入值； 所述多比特運算模塊從分比特計算模塊一、分比特計算模塊二選通列并行工作，接收權重值與多比特輸入值，進行多比特乘累加計算；計算位線CBL、CBLB用于通過電壓變化量反映多比特乘累加計算結果。

如需購買、轉讓、實施、許可或投資類似專利技術，可聯系本專利的申請人或專利權人安徽大學，其通訊地址為：230601 安徽省合肥市經濟技術開發區九龍路111號；或者聯系龍圖騰網官方客服，聯系龍圖騰網可撥打電話0551-65771310或微信搜索“龍圖騰網”。