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龍圖騰網獲悉北京兆訊恒達技術有限公司申請的專利一種系統級芯片設計的自動化集成方法及裝置獲國家發明授權專利權，本發明授權專利權由國家知識產權局授予，授權公告號為：CN119962446B 。

龍圖騰網通過國家知識產權局官網在2025-09-26發布的發明授權授權公告中獲悉：該發明授權的專利申請號/專利號為：202411941851.6，技術領域涉及：G06F30/32；該發明授權一種系統級芯片設計的自動化集成方法及裝置是由李凌浩;張智;范振偉;李立設計研發完成，并于2024-12-26向國家知識產權局提交的專利申請。

本一種系統級芯片設計的自動化集成方法及裝置在說明書摘要公布了：本發明公開了一種系統級芯片設計的自動化集成方法及裝置。該方法包括如下步驟：采用信號組作為接口對每個IP模塊進行接口封裝并生成相應的接口封裝文件；構建系統層級結構文件，用于描述系統層級結構關系及模塊組成；采用自動化集成軟件對系統層級結構文件及接口封裝文件進行信息提取，并對系統層級結構及IP模塊進行自動例化和接口連接，生成系統Verilog代碼文件；對Verilog代碼文件進行初步驗證后輸出最終的系統Verilog代碼文件。該集成方法提高了系統設計的效率、系統集成的準確性和標準化，并且IP模塊的接口封裝具有復用性，可在不同項目的SoC系統集成中重復使用。

本發明授權一種系統級芯片設計的自動化集成方法及裝置在權利要求書中公布了：1.一種系統級芯片設計的自動化集成方法，其特征在于包括如下步驟： 1采用信號組作為接口對每個IP模塊進行接口封裝，并生成相應的接口封裝文件；其中，包括如下子步驟： 11將每個IP模塊的多個分散信號劃分為一個或多個所述信號組，并對所述信號組進行定義，生成對應的信號組定義文件； 12根據所述信號組及所述信號組定義文件對每個IP模塊進行接口封裝，并生成相應的所述接口封裝文件； 2構建系統層級結構文件，用于描述系統層級結構關系及模塊組成； 3采用自動化集成軟件對所述系統層級結構文件進行信息提取，得到系統層級結構關系以及各層級的模塊組成； 4依據所述系統層級結構關系及IP模塊的所述接口封裝文件，采用所述自動化集成軟件對系統層級結構及IP模塊進行自動例化和接口連接，并生成系統集成后的Verilog代碼文件；其中，包括如下子步驟： 41讀取IP模塊的所述接口封裝文件，獲取每個IP模塊的接口信息； 42根據所述系統層級結構關系和模塊組成，由系統層級樹最底層開始，采用自下而上的順序，在各系統層級結構中例化模塊，并生成相應的Verilog代碼文件； 43根據所述系統層級結構關系和IP模塊的所述接口信息，對各系統層級結構中IP模塊進行接口連接，并生成相應的Verilog代碼文件； 5采用所述自動化集成軟件對系統集成后的所述Verilog代碼文件進行初步驗證，初步驗證通過后輸出系統Verilog代碼文件。

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