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龍圖騰網獲悉成都市晶蓉微電子有限公司申請的專利一種低功耗Sigma-Delta調制器獲國家發明授權專利權，本發明授權專利權由國家知識產權局授予，授權公告號為：CN120357904B 。

龍圖騰網通過國家知識產權局官網在2025-09-12發布的發明授權授權公告中獲悉：該發明授權的專利申請號/專利號為：202510859925.X，技術領域涉及：H03M3/00；該發明授權一種低功耗Sigma-Delta調制器是由黃寒航;段曉敏設計研發完成，并于2025-06-25向國家知識產權局提交的專利申請。

本一種低功耗Sigma-Delta調制器在說明書摘要公布了：本發明公開了一種低功耗Sigma?Delta調制器，屬于模擬集成電路設計領域。一種低功耗Sigma?Delta調制器，包括第一運放單元、第二運放單元、第三運放單元、比較器和數模轉換器。所述第一運放單元構造為第一級積分器，所述第二運放單元構造為第二級積分器和第三級積分器，所述第三運放單元構造為第四級積分器和有源加法器。本發明中的Sigma?Delta調制器只需要3個運算放大器即可實現4階SDM的功能，將4階CIFF結構的Sigma?Delta調制器中的運算放大器從傳統的5個減至3個，功耗降低約40%，面積縮小約40%，滿足MEMS傳感器的低功耗和微小型的要求。

本發明授權一種低功耗Sigma-Delta調制器在權利要求書中公布了：1.一種低功耗Sigma-Delta調制器，其特征在于，包括： 第一運放單元，所述第一運放單元構造為用于，在時鐘Φ1和Φ1d階段對差分輸入信號進行采樣，以及在時鐘Φ2和Φ2d階段對差分輸入信號與反饋信號做差后進行積分； 第二運放單元，所述第二運放單元構造為用于，在時鐘Φ1和Φ1d階段對第一運放單元輸出的差分輸出信號進行積分，且對積分后的差分輸出信號進行采樣，以及在時鐘Φ2和Φ2d階段對第一運放單元輸出的差分輸出信號進行采樣，且對采樣后的差分輸出信號進行積分； 第三運放單元，所述第三運放單元構造為用于，在時鐘Φ1和Φ1d階段對第二運放單元輸出的差分輸出信號進行積分，且作為有源加法器進行復位和采樣，以及在時鐘Φ2和Φ2d階段對第二運放單元輸出的差分輸出信號進行采樣，且作為有源加法器進行求和； 比較器，所述比較器構造為用于，在時鐘Φ2和Φ2d階段對有源加法器的求和結果進行量化，輸出比特流結果； 數模轉換器，所述數模轉換器構造為用于，在時鐘Φ2和Φ2d階段根據比特流結果輸出參考電壓，以及將參考電壓作為反饋信號反饋至第一運放單元； 其中，時鐘Φ1和時鐘Φ2為兩相非交疊時鐘，時鐘Φ1d為時鐘Φ1的延時相位時鐘，時鐘Φ2d為時鐘Φ2的延時相位時鐘；在時鐘Φ1和Φ1d階段以及時鐘Φ2和Φ2d階段，第二運放單元和第三運放單元中的運算放大器一直在工作，不會浪費電流； 所述第一運放單元包括第一運算放大器A1、采樣電容CS11和CS12、積分電容CI11和CI12、開關S1～S8； S1的第一端作為正差分信號輸入端，S3的第一端作為第一反饋信號端，S1的第二端分別與S3的第二端和CS11的第一端連接，CS11的第二端分別與S5的第一端和S7的第一端連接，S5的第二端接地，S7的第二端與A1的正輸入端連接； S2的第一端作為負差分信號輸入端，S4的第一端作為第二反饋信號端，S2的第二端分別與S4的第二端和CS12的第一端連接，CS12的第二端分別與S6的第一端和S8的第一端連接，S6的第二端接地，S8的第二端與A1的負輸入端連接； CI11的第一端與A1的正輸入端連接，CI11的第二端與A1的負輸出端連接，CI12的第一端與A1的負輸入端連接，CI12的第二端與A1的正輸出端連接； 所述第二運放單元包括第二運算放大器A2、采樣電容CS21和CS22、采樣電容CS31和CS32、積分電容CI21和CI22、積分電容CI31和CI32、開關S9～S26； CS21的第一端分別與A1的負輸出端和S9的第一端連接，S9的第二端接地，CS21的第二端分別與S11的第一端和S13的第一端連接，S11的第二端接地，S13的第二端與S15的第一端連接，S15的第二端與A2的正輸入端連接； CS22的第一端分別與A1的正輸出端和S10的第一端連接，S10的第二端接地，CS22的第二端分別與S12的第一端和S14的第一端連接，S12的第二端接地，S14的第二端與S16的第一端連接，S16的第二端與A2的負輸入端連接； CI21的第一端與S15的第一端連接，CI21的第二端與S23的第一端連接，S23的第二端與A2的負輸出端連接，S17的第一端與A2的正輸入端連接，S17的第二端分別與S19的第一端和CI31的第一端連接，CI31的第二端與S25的第一端連接，S25的第二端與A2的負輸出端連接，S19的第二端分別與S21的第一端和CS31的第一端連接，S21的第二端接地，CS31的第二端與S23的第一端連接； CI22的第一端與S16的第一端連接，CI22的第二端與S24的第一端連接，S24的第二端與A2的正輸出端連接，S18的第一端與A2的負輸入端連接，S18的第二端分別與S20的第一端和CI32的第一端連接，CI32的第二端與S26的第一端連接，S26的第二端與A2的正輸出端連接，S20的第二端分別與S22的第一端和CS32的第一端連接，S22的第二端接地，CS32的第二端與S24的第一端連接； 所述第三運放單元包括第三運算放大器A3，采樣電容CS41和CS42，積分電容CI41和CI42，開關S27～S52，前饋求和電容CA01、CA11、CA21、CA31、CA41、CA02、CA12、CA22、CA32、CA42，反饋電容CF11和CF12； CS41的第一端與S25的第一端連接，CS41的第二端分別與S27的第一端和S29的第一端連接，S27的第二端接地，S29的第二端與S31的第一端連接，S31的第二端與A3的正輸入端連接；CS42的第一端與S26的第一端連接，CS42的第二端分別與S28的第一端和S30的第一端連接，S28的第二端接地，S30的第二端與S32的第一端連接，S32的第二端與A3的負輸入端連接； S39的第一端接正差分信號輸入端，S39的第二端與CA01的第一端和S51的第一端連接，S51的第二端接地，CA01的第二端分別CA11的第一端、CA21的第一端、CA31的第一端和S33的第一端連接，CA11的第二端與A1的正輸出端連接，CA21的第二端分別與S23的第一端和S35的第一端連接，S35的第二端接地，CA31的第二端分別與S26的第一端和S37的第一端連接，S37的第二端接地，S33的第二端與A3的正輸入端連接；S40的第一端接負差分信號輸入端，S40的第二端與CA02的第一端和S52的第一端連接，S52的第二端接地，CA02的第二端分別與CA12的第一端、CA22的第一端、CA32的第一端和S34的第一端連接，CA12的第二端與A2的負輸出端連接，CA22的第二端分別與S24的第一端和S36的第一端連接，S36的第二端接地，CA32的第二端分別與S25的第一端和S38的第一端連接，S38的第二端接地，S34的第二端與A3的負輸入端連接； CI41的第一端與S31的第一端連接，CI41的第二端與S45的第一端連接，S45的第二端與A3的負輸出端連接，CF11的第一端與S33的第一端連接，CF11的第二端分別與S47的第一端、S49的第一端和比較器的第一輸入端連接，S47的第二端與A3的負輸出端連接，S49的第二端接地，CA41的第一端分別與S33的第一端和S41的第一端連接，S41的第二端接地，CA41的第二端分別與S43的第一端和S45的第一端連接，S43的第二端接地；CI42的第一端與S32的第一端連接，CI42的第二端與S46的第一端連接，S46的第二端與A3的正輸出端連接，CF12的第一端與S34的第一端連接，CF12的第二端分別與S48的第一端、S50的第一端和比較器的第二輸入端連接，S48的第二端與A3的正輸出端連接，S50的第二端接地，CA42的第一端分別與S34的第一端和S42的第一端連接，S42的第二端接地，CA42的第二端分別與S44的第一端和S46的第一端連接，S44的第二端接地。

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