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龍圖騰網(wǎng)獲悉北京時代民芯科技有限公司;北京微電子技術(shù)研究所申請的專利一種FDSOI工藝的雙電源冗余鎖存瞬時劑量率輻射加固觸發(fā)器獲國家發(fā)明授權(quán)專利權(quán)，本發(fā)明授權(quán)專利權(quán)由國家知識產(chǎn)權(quán)局授予，授權(quán)公告號為：CN116131814B 。

龍圖騰網(wǎng)通過國家知識產(chǎn)權(quán)局官網(wǎng)在2025-08-29發(fā)布的發(fā)明授權(quán)授權(quán)公告中獲悉：該發(fā)明授權(quán)的專利申請?zhí)?專利號為：202211493609.8，技術(shù)領(lǐng)域涉及：H03K3/356；該發(fā)明授權(quán)一種FDSOI工藝的雙電源冗余鎖存瞬時劑量率輻射加固觸發(fā)器是由李同德;趙元富;杜芊;苑靖爽;孫雨;隋成龍;曹煒亦設(shè)計研發(fā)完成，并于2022-11-25向國家知識產(chǎn)權(quán)局提交的專利申請。

本一種FDSOI工藝的雙電源冗余鎖存瞬時劑量率輻射加固觸發(fā)器在說明書摘要公布了：本發(fā)明涉及一種適用于FDSOI工藝的雙電源冗余鎖存瞬時劑量率輻射加固觸發(fā)器結(jié)構(gòu),屬于抗輻射集成電路設(shè)計技術(shù)領(lǐng)域。通過增加冗余鎖存結(jié)構(gòu)，抑制由瞬時劑量率輻射導(dǎo)致的電源塌陷所引起的觸發(fā)器輸出數(shù)據(jù)翻轉(zhuǎn)和擾動。冗余鎖存結(jié)構(gòu)采用與觸發(fā)器主體結(jié)構(gòu)不同的電源供電，并進行版圖加固設(shè)計。整體電路采用晶體管堆疊結(jié)構(gòu)，提高觸發(fā)器抗瞬時劑量率輻射的能力。本發(fā)明的設(shè)計基于商用規(guī)則，可操作性強，易實現(xiàn)。

本發(fā)明授權(quán)一種FDSOI工藝的雙電源冗余鎖存瞬時劑量率輻射加固觸發(fā)器在權(quán)利要求書中公布了：1.一種FDSOI工藝的雙電源冗余鎖存瞬時劑量率輻射加固觸發(fā)器，其特征在于包括：輸入電路、主鎖存電路、傳輸控制電路、從鎖存電路、輸出電路、第一時鐘信號電路CLK1以及第二時鐘信號電路CLK2； 所述第一時鐘信號電路CLK1包括電源為VDDC的第六堆疊反相器INV13和第七堆疊反相器INV14；第二時鐘信號電路CLK2包括電源為VDD的第八堆疊反相器INV15和第九堆疊反相器INV16； 第六堆疊反相器INV13接收外部發(fā)送的時鐘信號CLK,其輸出信號傳輸給第七堆疊反相器INV14，第七堆疊反相器INV14的輸出信號和第六堆疊反相器INV13的輸出信號共同作為第一時鐘信號電路CLK1的輸出時鐘信號； 第八堆疊反相器INV15接收外部發(fā)送的時鐘信號CLK,其輸出信號傳輸給第九堆疊反相器INV16，第九堆疊反相器INV16的輸出信號和第八堆疊反相器INV15的輸出信號共同作為第二時鐘信號電路CLK2的輸出時鐘信號； 輸入電路包括電源為VDD的第一堆疊反相器INV1和第二堆疊反相器INV2；主鎖存電路包括電源為VDD的第一時鐘控制堆疊反相器INV3、第三堆疊反相器INV4和第二時鐘控制堆疊反相器INV5；傳輸控制電路包括電源為VDD的第三時鐘控制堆疊反相器INV6；從鎖存電路包括電源為VDDC的第四堆疊反相器INV7、第四時鐘控制堆疊反相器INV8、第五時鐘控制堆疊反相器INV9和電源為VDD的第六時鐘控制堆疊反相器INV10、第五堆疊反相器INV11；輸出電路包括電源為VDDC的反相器INV12； 第一堆疊反相器INV1接收外部傳來的輸入信號，第一堆疊反相器INV1的輸出信號傳輸給第二堆疊反相器INV2；第二堆疊反相器INV2的輸出信號傳輸給第一時鐘控制堆疊反相器INV3，第一時鐘控制堆疊反相器INV3也接收第二時鐘信號電路CLK2的輸出時鐘信號，第一時鐘控制堆疊反相器INV3的輸出信號傳輸給第三堆疊反相器INV4，第三堆疊反相器INV4的輸出信號傳輸給第二時鐘控制堆疊反相器INV5和第三時鐘控制堆疊反相器INV6，第二時鐘控制堆疊反相器INV5和第三時鐘控制堆疊反相器INV6也接收第二時鐘信號電路CLK2的輸出時鐘信號，第二時鐘控制堆疊反相器INV5的輸出信號傳輸給第三堆疊反相器INV4，第三時鐘控制堆疊反相器INV6的輸出信號傳輸給第五時鐘控制堆疊反相器INV9、第五堆疊反相器INV11和反相器INV12，第五時鐘控制堆疊反相器INV9也接收第一時鐘信號電路CLK1的輸出時鐘信號，第五時鐘控制堆疊反相器INV9的輸出信號傳輸給第四堆疊反相器INV7，第四堆疊反相器INV7的輸出信號傳輸給第四時鐘控制堆疊反相器INV8、第五時鐘控制堆疊反相器INV9、第五堆疊反相器INV11和反相器INV12，第四時鐘控制堆疊反相器INV8也接收第一時鐘信號電路CLK1的輸出時鐘信號，第四時鐘控制堆疊反相器INV8的輸出信號傳輸給第四堆疊反相器INV7，第五堆疊反相器INV11的輸出信號傳輸給第六時鐘控制堆疊反相器INV10，第六時鐘控制堆疊反相器INV10也接收第二時鐘信號電路CLK2的輸出時鐘信號，第六時鐘控制堆疊反相器INV10的輸出信號傳輸給第五時鐘控制堆疊反相器INV9、第五堆疊反相器INV11和反相器INV12，反相器INV12的輸出信號即為輸出電路的輸出； 第一時鐘信號電路CLK1將時鐘信號送入從鎖存電路；第二時鐘信號電路CLK2將時鐘信號送入主鎖存電路、傳輸控制電路及從鎖存電路； 輸入電路在時鐘信號為低電平時將輸入數(shù)據(jù)信號送入主鎖存電路；主鎖存電路在時鐘信號為低電平時將數(shù)據(jù)信號送入傳輸控制電路；主鎖存電路在時鐘信號為高電平時將數(shù)據(jù)信號鎖存； 傳輸控制電路在時鐘信號為高電平時將數(shù)據(jù)信號送入從鎖存電路；從鎖存電路在時鐘信號為高電平時將數(shù)據(jù)信號送入輸出電路；從鎖存電路在時鐘信號為低電平時將數(shù)據(jù)信號鎖存，并且將鎖存的數(shù)據(jù)信號送入輸出電路；輸出電路將數(shù)據(jù)信號輸出。

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