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龍圖騰網(wǎng)獲悉深圳市華普微電子股份有限公司申請的專利一種連續(xù)時間sigma-delta調(diào)制器時間常數(shù)的校準(zhǔn)電路獲國家發(fā)明授權(quán)專利權(quán)，本發(fā)明授權(quán)專利權(quán)由國家知識產(chǎn)權(quán)局授予，授權(quán)公告號為：CN120342399B 。

龍圖騰網(wǎng)通過國家知識產(chǎn)權(quán)局官網(wǎng)在2025-09-16發(fā)布的發(fā)明授權(quán)授權(quán)公告中獲悉：該發(fā)明授權(quán)的專利申請?zhí)?專利號為：202510829358.3，技術(shù)領(lǐng)域涉及：H03M3/00；該發(fā)明授權(quán)一種連續(xù)時間sigma-delta調(diào)制器時間常數(shù)的校準(zhǔn)電路是由黃恭興;武怡康設(shè)計研發(fā)完成，并于2025-06-20向國家知識產(chǎn)權(quán)局提交的專利申請。

本一種連續(xù)時間sigma-delta調(diào)制器時間常數(shù)的校準(zhǔn)電路在說明書摘要公布了：本發(fā)明屬于集成電路技術(shù)領(lǐng)域，具體涉及一種連續(xù)時間sigma?delta調(diào)制器時間常數(shù)的校準(zhǔn)電路，通過使用固定時間積分的方法，并利用sigma?delta調(diào)制器的系統(tǒng)采樣時鐘周期的倍數(shù)作為積分時間，不僅減少了對額外高頻校準(zhǔn)時鐘的需求，還使得即使在系統(tǒng)時鐘存在誤差的情況下也能實現(xiàn)高精度的時間常數(shù)校準(zhǔn)。這種設(shè)計能夠顯著減小實際sigma?delta調(diào)制器電路的系統(tǒng)傳遞函數(shù)與理想系統(tǒng)之間的偏差，確保了調(diào)制器的高性能表現(xiàn)。同時，由于采用了與調(diào)制器電路相同的運算放大器和成比例的電容電阻，最大限度地模擬了真實的積分過程，從而進(jìn)一步提高了校準(zhǔn)的準(zhǔn)確性。

本發(fā)明授權(quán)一種連續(xù)時間sigma-delta調(diào)制器時間常數(shù)的校準(zhǔn)電路在權(quán)利要求書中公布了：1.一種連續(xù)時間sigma-delta調(diào)制器時間常數(shù)的校準(zhǔn)電路，其特征在于，包括積分器、靜態(tài)比較器和數(shù)字邏輯電路； 其中，所述積分器由sigma-delta調(diào)制器中的積分器電路復(fù)制而成，包括輸入電阻R1、積分電容陣列C、固定電阻R2、運算放大器以及開關(guān)S1、S2、S3； 所述積分電容陣列C的接入面積通過數(shù)字碼字控制開關(guān)進(jìn)行調(diào)節(jié)；所述積分器的輸入端連接參考電壓VREFP和VREFN，輸出端連接積分電容陣列C；所述積分器的輸出端連接靜態(tài)比較器的輸入端，靜態(tài)比較器的輸出端通過D觸發(fā)器連接數(shù)字邏輯電路；所述數(shù)字邏輯電路根據(jù)比較器的輸出結(jié)果調(diào)整積分電容陣列C的數(shù)字碼值； 所述積分器的工作模式包括差分放大模式和積分器模式； 所述積分器的輸入端包括四條支路：VREFP-R1-S1，VREFN-R1-S2，VREFN-R1-S1，VREFP-R1-S2；開關(guān)S1和S3受同一時鐘控制，開關(guān)S2受時鐘控制；通過開關(guān)的切換實現(xiàn)積分器在差分放大模式和積分器模式之間的切換； 在差分放大模式下，開關(guān)S1和S3閉合，運算放大器作為差分放大器工作，輸入端VIP連接VREFP-R1-S1支路，輸入端VIN連接VREFN-R1-S1支路；在積分器模式下，開關(guān)S1和S3斷開，開關(guān)S2閉合，運算放大器工作在積分器模式，輸入端VIP連接VREFN-R1-S2支路，輸入端VIN連接VREFP-R1-S2支路； 在積分器模式下，積分電容陣列C在恒定差分電流作用下進(jìn)行充放電，充放電時間由系統(tǒng)采樣時鐘分頻控制，積分過程持續(xù)n個系統(tǒng)采樣時鐘周期，其中n為預(yù)設(shè)的整數(shù)；積分結(jié)束后，運算放大器的差分輸出電壓通過靜態(tài)比較器進(jìn)行比較，以判斷積分電容陣列C的實際值是否滿足設(shè)計時間常數(shù)。

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