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龍圖騰網獲悉江蘇集萃智能集成電路設計技術研究所有限公司申請的專利一種單時鐘控制高速比較器電路獲國家發明授權專利權，本發明授權專利權由國家知識產權局授予，授權公告號為：CN114257222B 。

龍圖騰網通過國家知識產權局官網在2025-08-22發布的發明授權授權公告中獲悉：該發明授權的專利申請號/專利號為：202111602066.4，技術領域涉及：H03K5/24；該發明授權一種單時鐘控制高速比較器電路是由宋佳音;楊中;付江鐸;楊浩涵;陳文亞;黃一斌;樊曉華設計研發完成，并于2021-12-24向國家知識產權局提交的專利申請。

本一種單時鐘控制高速比較器電路在說明書摘要公布了：本發明公開了一種單時鐘控制高速比較器電路，其可滿足比較器的高速應用環境需求，同時可降低功耗和輸入噪聲，該比較器電路包括動態放大電路模塊、比較決策電路模塊、輸出寄存模塊，動態放大電路模塊的輸入端連接時鐘信號CLK，動態放大電路模塊的輸出端依次連接比較決策電路模塊、輸出寄存模塊，動態放大電路模塊包括若干控制單元，控制單元由若干MOS管組成，通過控制單元的充放電實現輸入電壓信號的放大，比較決策電路模塊包括交叉耦合反相器對，用于提供正反饋結構，并對動態放大電路輸出的信號再次放大和隔離，輸出寄存模塊包括鎖存器，用于暫存輸出信號。

本發明授權一種單時鐘控制高速比較器電路在權利要求書中公布了：1.一種單時鐘控制高速比較器電路，包括動態放大電路模塊、比較決策電路模塊、輸出寄存模塊，其特征在于，所述動態放大電路模塊的輸入端連接時鐘信號CLK，所述動態放大電路模塊的輸出端依次連接所述比較決策電路模塊、所述輸出寄存模塊； 所述動態放大電路模塊包括若干控制單元，所述控制單元由若干MOS管組成，通過所述控制單元的充放電實現輸入電壓信號的放大； 所述比較決策電路模塊包括交叉耦合反相器對，用于提供正反饋結構，并對所述動態放大電路輸出的信號再次放大和隔離； 所述輸出寄存模塊包括鎖存器，用于暫存輸出信號； 所述比較決策電路模塊還包括中間傳輸級、決策加速單元，所述中間傳輸級的輸入端連接所述動態放大電路中的輸出信號N3、N4，所述中間傳輸級的輸出端依次連接所述交叉耦合反相器對、決策加速單元，所述中間傳輸級用于對所述輸出信號N3、N4進行一次放大，所述交叉耦合反相器對用于所述中間傳輸級輸出的信號再次放大和隔離，所述決策加速單元包括尾電流源、脈沖分配控制單元，所述尾電流源用于給所述交叉耦合反相器對提供電流，所述脈沖分配控制單元用于分配脈沖信號； 所述中間傳輸級包括MOS管MP7、MP8，所述交叉耦合反相器包括MOS管MP5、MN5、MP6、MN6，所述決策加速單元包括MOS管MN7~MN12，所述MOS管MP7、MP8、MP5、MP6的源極均連接電壓源VDD，所述MOS管MP7、MN11、MN7的基極連接后與所述輸出信號N3連接，所述MOS管MP8、MN11、MN8的基極連接后與所述輸出信號N4連接，所述MOS管MN7、MN11、MN8、MN12的源極均連接電壓源VSS，所述MOS管MN11的漏極連接所述MOS管MN9的源極，所述MOS管MN9、MP7、MP5、MN5的漏極與所述MOS管MP6、MN6的基極連接并輸出信號N6，所述MOS管MP6、MN6、MP8、MP10的漏極與所述MOS管MP5、MN5的基極連接并輸出信號N5，所述MOS管MN6的源極與所述MOS管MN8的漏極連接，所述MOS管MN9、MN10的基極分別連接時鐘信號CLK1； 所述高速比較器電路還包括時鐘電路，所述時鐘電路包括延遲單元、反相器和與門，所述延遲單元、第三反相器、與門依次串聯連接，所述延遲單元的輸入端1端口連接所述時鐘電路的第一時鐘信號端，所述與門的輸出為所述時鐘電路的第二時鐘信號端，所述第一時鐘信號端輸出時鐘信號CLK，所述第二時鐘信號端輸出時鐘信號CLK1。

如需購買、轉讓、實施、許可或投資類似專利技術，可聯系本專利的申請人或專利權人江蘇集萃智能集成電路設計技術研究所有限公司，其通訊地址為：214000 江蘇省無錫市新吳區菱湖大道111號無錫軟件園天鵝座C座18樓；或者聯系龍圖騰網官方客服，聯系龍圖騰網可撥打電話0551-65771310或微信搜索“龍圖騰網”。