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龍圖騰網獲悉電子科技大學申請的專利基于靜態分段補償方法的近似二進制乘法器獲國家發明授權專利權，本發明授權專利權由國家知識產權局授予，授權公告號為：CN115826913B 。

龍圖騰網通過國家知識產權局官網在2025-09-12發布的發明授權授權公告中獲悉：該發明授權的專利申請號/專利號為：202211373911.X，技術領域涉及：G06F7/533；該發明授權基于靜態分段補償方法的近似二進制乘法器是由賀雅娟;侯博文;彭澤陽;王梓霖;張竣朋;張波設計研發完成，并于2022-11-04向國家知識產權局提交的專利申請。

本基于靜態分段補償方法的近似二進制乘法器在說明書摘要公布了：本發明提出的基于靜態分段截斷補償方法的近似二進制乘法器結構，考慮了乘法器輸入的分布規律而進行分段，在乘法器輸入高位冗余概率較大的情況下將冗余部分積截斷，降低了硬件資源消耗并很好的保持了精度；在乘法器輸入高位不冗余的概率較大的情況下，在截斷低有效位的部分積后進行了基于部分積的概率分析的誤差補償電路設計，使其適用于通用的可容錯應用場景。并且在兩種情況下，乘法器輸入經過部分積生成電路產生的部分積輸入到同樣的進一步采用了截斷補償方法的部分積壓縮電路中，而不需要兩種情況使用不同的部分積壓縮電路，實現了資源的共享從而降低了硬件資源消耗，保證了本發明在大部分應用場景中實現了電路硬件性能和精度很好的折中。

本發明授權基于靜態分段補償方法的近似二進制乘法器在權利要求書中公布了：1.基于靜態分段補償的近似二進制乘法器，其特征在于，包括部分積生成模塊、部分積壓縮模塊和加法器模塊； 所述部分積生成模塊用于對乘數進行編碼并根據編碼信號對被乘數進行解碼來生成部分積陣列； 所述部分積壓縮模塊用于對部分積陣列進行壓縮，最終壓縮為兩行部分積； 所述加法器模塊將壓縮得到的兩行部分積相加得到所述近似二進制乘法器的輸出； 所述部分積生成模塊采用基-4Booth編碼的方法，具體為：將乘數靜態地分為多個編碼位段，進行冗余位判斷并選擇出有效位段進行Booth編碼，其余位段被截斷；所述冗余位判斷的方式是判斷最高編碼位段是否冗余，定義乘數被分為4個編碼位段進行編碼，用m3到m0表示，則判斷m3是否為全1或全0，如果是，則最高編碼位段冗余，將m3截斷，m2到m0參加到Booth編碼過程中，否則，將m0截斷，m3到m1參加到Booth編碼過程中； 所述部分積壓縮模塊對經Booth編碼生成的部分積陣列進行截斷補償后進行壓縮，分為最高編碼位段冗余和不冗余兩種情況，具體為： 對于8×8有符號數基-4Booth乘法器，完整的部分積陣列共有4行16列； 若最高編碼位段冗余，在部分積陣列中就是第4行被截斷，此時剩余部分積陣列包括部分積前3行以及每行包含的部分積拓展位和符號補償位； 若最高編碼位段不冗余，在部分積陣列中就是第1行被截斷，在部分積陣列的第2行部分積的第11，12，13列分別補償，和，等于該部分積行最高位的部分積，是的非，此時剩余的部分積陣列與最高編碼位段冗余情況下相同，包括部分積前3行以及每行包含的部分積拓展位和符號補償位； 對部分積前3行以及每行包含的部分積拓展位組成的剩余部分積陣列繼續進行截斷補償，剩余部分積陣列包括3行14列，此時不再區分最高編碼位段冗余和不冗余兩種情況，將部分積陣列的低4列部分積以及屬于第3行部分積的符號補償位全部截斷，第5列部分積的第1行和第2行處共2個部分積輸入一個或門，輸出到第6列部分積陣列中參與后續壓縮過程，第5列部分積的第3行處的部分積直接移到第6列部分積陣列中參與后續壓縮過程。

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