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龍圖騰網(wǎng)獲悉中國科學(xué)院近代物理研究所申請的專利一種加速器事例解析和監(jiān)控裝置獲國家發(fā)明授權(quán)專利權(quán)，本發(fā)明授權(quán)專利權(quán)由國家知識產(chǎn)權(quán)局授予，授權(quán)公告號為：CN116125883B 。

龍圖騰網(wǎng)通過國家知識產(chǎn)權(quán)局官網(wǎng)在2025-09-05發(fā)布的發(fā)明授權(quán)授權(quán)公告中獲悉：該發(fā)明授權(quán)的專利申請?zhí)?專利號為：202310049165.7，技術(shù)領(lǐng)域涉及：G05B19/042；該發(fā)明授權(quán)一種加速器事例解析和監(jiān)控裝置是由李敏;孫志宇;余玉洪;李維龍;周凱;毛瑞士;趙鐵成設(shè)計研發(fā)完成，并于2023-02-01向國家知識產(chǎn)權(quán)局提交的專利申請。

本一種加速器事例解析和監(jiān)控裝置在說明書摘要公布了：本發(fā)明涉及加速器事例解析和監(jiān)控裝置，包括：核心板和底板；所述核心板和所述底板通過RMC連接器相連接；所述核心板包括處理器和FPGA；所述底板上設(shè)置有第一數(shù)目的光纖輸入接口和光纖輸出接口；所述底板上還設(shè)置有第二數(shù)目的BNCCMOS接口；所述光纖輸入接口、所述光纖輸出接口和所述BNCCMOS接口通過所述RMC連接器連接所述FPGA；所述處理器，用于接收加速器的運行控制參數(shù)，并下發(fā)至所述FPGA；所述FPGA，用于通過所述光纖輸入接口接收加速器運行的事例信息，根據(jù)所述事例信息和所述運行控制參數(shù)，產(chǎn)生對應(yīng)的PWM波信號作為觸發(fā)信號，并通過所述光纖輸出接口或所述BNCCMOS接口輸出；所述處理器，還用于對所述FPGA處理的數(shù)據(jù)進(jìn)行監(jiān)控，并上傳至上位機。

本發(fā)明授權(quán)一種加速器事例解析和監(jiān)控裝置在權(quán)利要求書中公布了：1.一種加速器事例解析和監(jiān)控裝置，其特征在于，包括：核心板和底板；所述核心板和所述底板通過RMC連接器相連接； 所述核心板包括相連接的處理器和FPGA； 所述底板上設(shè)置有第一數(shù)目的光纖輸入接口和光纖輸出接口；所述底板上還設(shè)置有第二數(shù)目的BNCCMOS接口；所述光纖輸入接口、所述光纖輸出接口和所述BNCCMOS接口分別通過所述RMC連接器連接至所述FPGA； 所述處理器，用于接收加速器控制系統(tǒng)發(fā)送的運行控制參數(shù)，并下發(fā)至所述FPGA； 所述FPGA，用于通過所述光纖輸入接口接收加速器運行的事例信息，根據(jù)所述事例信息和所述運行控制參數(shù)，產(chǎn)生對應(yīng)的PWM波信號作為觸發(fā)信號，并通過所述光纖輸出接口或所述BNCCMOS接口輸出； 所述處理器，還用于對所述FPGA處理的所述光纖輸入接口、所述光纖輸出接口和所述BNCCMOS接口的數(shù)據(jù)進(jìn)行監(jiān)控，并上傳至上位機； 所述第一數(shù)目為4，所述第二數(shù)目為7；所述BNCCMOS接口實現(xiàn)3.3VCMOS輸出、兼容5VTTL輸入； 所述FPGA的數(shù)據(jù)流以4路光輸入和7路TTL輸入組成11路外部輸入；所述FPGA的內(nèi)部生成信號，與外部輸入一起組成13路備選信號，供4路光輸出和7路TTL輸出選擇。

如需購買、轉(zhuǎn)讓、實施、許可或投資類似專利技術(shù)，可聯(lián)系本專利的申請人或?qū)＠麢?quán)人中國科學(xué)院近代物理研究所，其通訊地址為：730013 甘肅省蘭州市城關(guān)區(qū)南昌路509號；或者聯(lián)系龍圖騰網(wǎng)官方客服，聯(lián)系龍圖騰網(wǎng)可撥打電話0551-65771310或微信搜索“龍圖騰網(wǎng)”。