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龍圖騰網(wǎng)獲悉西安微電子技術(shù)研究所申請(qǐng)的專(zhuān)利一種PROM程序存儲(chǔ)區(qū)擴(kuò)展EDAC校驗(yàn)電路及方法獲國(guó)家發(fā)明授權(quán)專(zhuān)利權(quán)，本發(fā)明授權(quán)專(zhuān)利權(quán)由國(guó)家知識(shí)產(chǎn)權(quán)局授予，授權(quán)公告號(hào)為：CN114385410B 。

龍圖騰網(wǎng)通過(guò)國(guó)家知識(shí)產(chǎn)權(quán)局官網(wǎng)在2025-08-26發(fā)布的發(fā)明授權(quán)授權(quán)公告中獲悉：該發(fā)明授權(quán)的專(zhuān)利申請(qǐng)?zhí)?專(zhuān)利號(hào)為：202210033978.2，技術(shù)領(lǐng)域涉及：G06F11/10；該發(fā)明授權(quán)一種PROM程序存儲(chǔ)區(qū)擴(kuò)展EDAC校驗(yàn)電路及方法是由全勇濤;路海全;劉曙蓉;楊文清;賈可輝;賈森;劉秀娜;曲翕設(shè)計(jì)研發(fā)完成，并于2022-01-12向國(guó)家知識(shí)產(chǎn)權(quán)局提交的專(zhuān)利申請(qǐng)。

本一種PROM程序存儲(chǔ)區(qū)擴(kuò)展EDAC校驗(yàn)電路及方法在說(shuō)明書(shū)摘要公布了：本發(fā)明提供一種PROM程序存儲(chǔ)區(qū)擴(kuò)展EDAC校驗(yàn)電路及方法，用于解決現(xiàn)有星載計(jì)算機(jī)PROM程序區(qū)單比特?cái)?shù)據(jù)錯(cuò)誤的問(wèn)題，降低空間環(huán)境單粒子翻轉(zhuǎn)的風(fēng)險(xiǎn)，提高產(chǎn)品的可靠性。包括集成有EDAC糾檢錯(cuò)功能的處理器、SRAM數(shù)據(jù)存儲(chǔ)區(qū)和PROM程序存儲(chǔ)校驗(yàn)區(qū)；其中，SRAM數(shù)據(jù)存儲(chǔ)區(qū)包括用于存儲(chǔ)數(shù)據(jù)的第一SRAM和用于存儲(chǔ)SRAM區(qū)EDAC碼的第二SRAM，PROM程序存儲(chǔ)校驗(yàn)區(qū)包括多片用于存儲(chǔ)程序的PROM以及用于存儲(chǔ)程序區(qū)EDAC校驗(yàn)碼的PROM；處理器的數(shù)據(jù)總線(xiàn)接用于存儲(chǔ)程序的PROM，處理器的EDAC總線(xiàn)接用于存儲(chǔ)程序區(qū)EDAC校驗(yàn)碼的PROM。

本發(fā)明授權(quán)一種PROM程序存儲(chǔ)區(qū)擴(kuò)展EDAC校驗(yàn)電路及方法在權(quán)利要求書(shū)中公布了：1.一種PROM程序存儲(chǔ)區(qū)擴(kuò)展EDAC校驗(yàn)電路，其特征在于，包括集成有EDAC糾檢錯(cuò)功能的處理器（1）、SRAM數(shù)據(jù)存儲(chǔ)區(qū)和PROM程序存儲(chǔ)校驗(yàn)區(qū)； 其中，所述SRAM數(shù)據(jù)存儲(chǔ)區(qū)包括用于存儲(chǔ)數(shù)據(jù)的第一SRAM（3）和用于存儲(chǔ)SRAM區(qū)EDAC碼的第二SRAM（4），所述PROM程序存儲(chǔ)校驗(yàn)區(qū)包括多片用于存儲(chǔ)程序的PROM以及用于存儲(chǔ)程序區(qū)EDAC校驗(yàn)碼的PROM； 所述處理器（1）的地址總線(xiàn)A[2:20]通過(guò)驅(qū)動(dòng)器（2）分別接第一SRAM（3）和第二SRAM（4）的地址線(xiàn)A[0:18]，所述處理器（1）的地址總線(xiàn)A[2:16]通過(guò)驅(qū)動(dòng)器（2）分別接PROM存儲(chǔ)器的地址線(xiàn)A[0:14]； 所述處理器（1）的數(shù)據(jù)總線(xiàn)接用于存儲(chǔ)程序的PROM，所述處理器（1）的EDAC總線(xiàn)接用于存儲(chǔ)程序區(qū)EDAC校驗(yàn)碼的PROM； 所述用于存儲(chǔ)程序的PROM包括第一PROM（5）、第二PROM（6）、第三PROM（7）和第四PROM（8），所述存儲(chǔ)程序區(qū)EDAC校驗(yàn)碼的PROM包括第五PROM（9）； 其中，所述第一PROM（5）的數(shù)據(jù)總線(xiàn)接所述處理器（1）的數(shù)據(jù)總線(xiàn)D[0:7]，第二PROM（6）的數(shù)據(jù)總線(xiàn)接所述處理器（1）的數(shù)據(jù)總線(xiàn)D[8:15]，第三PROM（7）的數(shù)據(jù)總線(xiàn)接所述處理器（1）的數(shù)據(jù)總線(xiàn)D[16:23]，第四PROM（8）的數(shù)據(jù)總線(xiàn)接所述處理器（1）的數(shù)據(jù)總線(xiàn)D[24:31]，第五PROM（9）的數(shù)據(jù)總線(xiàn)接所述處理器（1）的EDAC總線(xiàn)CB[0:7]。

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