江南大學虞致國獲國家專利權
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龍圖騰網獲悉江南大學申請的專利一種降低IR Drop的存算陣列折疊布局方法獲國家發明授權專利權,本發明授權專利權由國家知識產權局授予,授權公告號為:CN114822627B 。
龍圖騰網通過國家知識產權局官網在2025-08-26發布的發明授權授權公告中獲悉:該發明授權的專利申請號/專利號為:202210167096.5,技術領域涉及:G11C8/08;該發明授權一種降低IR Drop的存算陣列折疊布局方法是由虞致國;王雨桐;鐘嘯宇;顧曉峰設計研發完成,并于2022-02-23向國家知識產權局提交的專利申請。
本一種降低IR Drop的存算陣列折疊布局方法在說明書摘要公布了:本發明公開了一種降低IRDrop的存算陣列折疊布局方法,存算陣列包括m行存算單元與n列存算單元;字線端WL1至WLm分別連接至1至m行的存算單元,位線BL端BL1至BLn分別連接至1至n列的存算單元,源線端SL1至SLn分別連接至1至n列存算單元的源端,所述方法包括:步驟一:將m×n的存算陣列在字線端WLm2處沿字線WL方向切斷;步驟二:將相同的位線BL與相同的源線SL進行跨線連接;步驟三:將跨線連接的兩個m2×n的存算陣列交叉合并;步驟四:將字線WL端的WL1至WLm2由陣列一側引出,字線WL端WLm2+1至WLm由陣列另一側引出。
本發明授權一種降低IR Drop的存算陣列折疊布局方法在權利要求書中公布了:1.一種降低IRDrop的存算陣列折疊布局方法,其特征在于,所述存算陣列包括m行存算單元與n列存算單元,每個存算單元由一個非易失性存算器件構成;所述存算陣列的字線端WL1至WLm分別連接至1至m行的存算單元,為所述存算陣列的數據輸入端,所述存算陣列的位線端BL1至BLn分別連接至1至n列的存算單元,為所述存算陣列的數據輸出端,所述存算陣列的源線端SL1至SLn分別連接至1至n列存算單元的源端,所述數據輸入端與所述數據輸出端在連接方向上相互垂直,所述方法包括如下步驟: 步驟一:將m×n的存算陣列在字線端WLm2處沿字線WL方向切斷,形成兩個m2×n的存算陣列; 步驟二:將由步驟一得到的兩個m2×n的存算陣列中,相同的位線BL與相同的源線SL進行跨線連接; 步驟三:將跨線連接的兩個m2×n的存算陣列交叉合并:將相同的位線BL合并,由一條金屬線引出;將相同的源線SL合并,由一條金屬線引出; 步驟四:交叉合并后的存算陣列中,將字線WL端的WL1至WLm2由陣列一側引出,字線WL端WLm2+1至WLm由陣列另一側引出; 由所述步驟三交叉合并后的存算陣列中,位線BL端BL1至BLn的每條金屬線上連接有兩列存算單元; 所述方法還包括: 將位線BL端BL1至BLn中,n為偶數的位線BL相連接的兩列存算單元以該位線BL為中心進行鏡像對稱,并將對稱布局后相鄰的兩列存算單元的柵極互聯,由一條字線WL引出。
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