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龍圖騰網獲悉成都融見軟件科技有限公司;上海合見工業軟件集團有限公司申請的專利芯片FPGA原型驗證的目標debug數據獲取系統獲國家發明授權專利權，本發明授權專利權由國家知識產權局授予，授權公告號為：CN117724913B 。

龍圖騰網通過國家知識產權局官網在2025-08-22發布的發明授權授權公告中獲悉：該發明授權的專利申請號/專利號為：202311731728.7，技術領域涉及：G06F11/22；該發明授權芯片FPGA原型驗證的目標debug數據獲取系統是由羅文濤;郭晨光;王秉文;郭緘威設計研發完成，并于2023-12-15向國家知識產權局提交的專利申請。

本芯片FPGA原型驗證的目標debug數據獲取系統在說明書摘要公布了：本發明涉及芯片驗證技術領域，尤其涉及一種芯片FPGA原型驗證的目標debug數據獲取系統，包括軟件控制模塊、FPGA原型驗證模塊和存儲模塊，第一存儲區域包括N個存儲單元；軟件控制模塊控制將FPGA原型驗證模塊的輸入端口的輸入激勵數據以及對應的時鐘數據作為待存儲數據，將待存儲數據按順序存儲至第一存儲區域，當第一存儲區域中的每一Bn均存儲有數據時，則返回從B1開始，按順序以覆蓋Bn中的數據的方式向第一存儲區域存儲數據；當FPGA原型驗證模塊運行至目標觸發點時，軟件控制模塊基于目標觸發點獲取目標debug數據。本發明減少了debug數據所需存儲空間，提高了目標debug數據獲取的準確性和效率。

本發明授權芯片FPGA原型驗證的目標debug數據獲取系統在權利要求書中公布了：1.一種芯片FPGA原型驗證的目標debug數據獲取系統，其特征在于， 包括軟件控制模塊、FPGA原型驗證模塊和存儲模塊，其中，所述軟件控制模塊分別與FPGA原型驗證模塊和存儲模塊相連接，所述存儲模塊與FPGA原型驗證模塊相連接； 所述軟件控制模塊用于通過FPGA原型驗證模塊的輸入端口配置FPGA原型驗證模塊的初始狀態，以及向FPGA原型驗證模塊的輸入端口輸入激勵數據； 所述FPGA原型驗證模塊中燒錄有待驗證芯片對應的門級網表，從初始狀態開始運行，基于輸入端口接收的激勵數據對所述待驗證芯片執行FPGA原型驗證，輸入端口按照時鐘進行分組，從輸入端口選擇Y個時鐘對應的輸入激勵數據作為待轉存數據，待轉存數據大小為X； 所述存儲模塊包括第一存儲區域，所述第一存儲區域包括N個存儲單元{B1,B2,…,Bn,…,BN}，Bn為第n個存儲單元，n的取值范圍為1到N，Bn的大小大于（X+Y）； 所述軟件控制模塊控制將所述FPGA原型驗證模塊的輸入端口中所述選擇的Y個時鐘對應的待轉存數據以及所述選擇的Y個時鐘數據作為待存儲數據，按照B1,B2,…,Bn,…,BN的順序向所述第一存儲區域存儲所述待存儲數據，當向Bn中存儲所述待存儲數據時，先判斷Bn當前剩余的存儲空間是否大于等于（X+Y），若是，則將所述待存儲數據存儲至Bn中，否則，將所述待存儲數據存儲至Bn+1中，當存儲至BN且BN中的存儲空間小于（X+Y）時，將所述待存儲數據存儲至B1中； 當所述FPGA原型驗證模塊運行至目標觸發點時，所述軟件控制模塊基于所述目標觸發點獲取所述第一存儲區域中所存儲的數據作為目標debug數據，目標觸發點為需要進行debug的點。

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